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帶有加速器的基于芯粒的集成中央處理單元的制作方法

文檔序號(hào):42299036發(fā)布日期:2025-06-27 18:39閱讀:7來源:國(guó)知局

本公開涉及用于統(tǒng)一存儲(chǔ)器訪問的片上系統(tǒng)(system-on-chip,soc)方法和服務(wù)器系統(tǒng)。


背景技術(shù):

1、本文所提供的背景描述出于大體上呈現(xiàn)本公開的背景的目的。在本背景技術(shù)部分中描述的程度上,目前提到名字的一個(gè)或多個(gè)發(fā)明人的工作,以及說明書中的在提交申請(qǐng)時(shí)可能不符合現(xiàn)有技術(shù)條件的各方面,既不明確也不隱含地被認(rèn)為是相對(duì)于本公開的現(xiàn)有技術(shù)。

2、許多現(xiàn)代服務(wù)器系統(tǒng)利用片上系統(tǒng)(soc),所述soc包括使用快速外圍組件互連(peripheral?component?interconnect?express,pcie)連接到中央處理單元(centralprocessing?unit,cpu)的加速器。pcie盡管通??山邮苡糜跍p輕工作負(fù)載,但還是有幾個(gè)限制。例如,pcie可能不允許cpu與加速器之間共享地址空間。此外,加速器通常需要高帶寬和低時(shí)延來訪問公共存儲(chǔ)器。諸如pcie或計(jì)算快速鏈路(compute?express?link,cxl)等外部輸入/輸出(input/output,i/o)連接可能會(huì)增加系統(tǒng)的時(shí)延,因?yàn)橛捎趐cie/cxl端口和通道的數(shù)量有限,聚合帶寬是有限的。有限的端口和通道數(shù)目減少了可以附接到cpu的加速器數(shù)量,并且使得難以平衡cpu與加速器的比例以匹配應(yīng)用要求,這對(duì)cpu和加速器的效率產(chǎn)生了負(fù)面影響。


技術(shù)實(shí)現(xiàn)思路

1、根據(jù)本公開的第一方面,提供了一種片上系統(tǒng),該片上系統(tǒng)包括:中央處理單元(cpu);加速器,該加速器經(jīng)由第一晶粒間互連耦合到cpu;以及統(tǒng)一存儲(chǔ)器,該統(tǒng)一存儲(chǔ)器經(jīng)由第二晶粒間互連耦合到cpu,其中,為了防止加速器使用加速器存儲(chǔ)器進(jìn)行處理操作,加速器利用位于加速器中的統(tǒng)一存儲(chǔ)器訪問隧道系統(tǒng)來將與第二晶粒間互連相關(guān)聯(lián)的高級(jí)互連協(xié)議隧道傳輸(tunnel)到與第一晶粒間互連相關(guān)聯(lián)的晶粒間互連協(xié)議,統(tǒng)一存儲(chǔ)器訪問隧道系統(tǒng)被配置為允許使用共享地址空間來訪問統(tǒng)一存儲(chǔ)器。

2、在一些實(shí)施例中,統(tǒng)一存儲(chǔ)器訪問隧道系統(tǒng)利用統(tǒng)一存儲(chǔ)器訪問隧道數(shù)據(jù)包將高級(jí)互連協(xié)議隧道傳輸?shù)骄Яig互連協(xié)議。

3、在一些實(shí)施例中,統(tǒng)一存儲(chǔ)器訪問隧道數(shù)據(jù)包包括多個(gè)隧道字段,多個(gè)隧道字段被配置為允許加速器和cpu訪問映射到統(tǒng)一存儲(chǔ)器的共享地址空間。

4、在一些實(shí)施例中,統(tǒng)一存儲(chǔ)器訪問隧道系統(tǒng)向cpu提供統(tǒng)一存儲(chǔ)器訪問隧道數(shù)據(jù)包以訪問統(tǒng)一存儲(chǔ)器。

5、在一些實(shí)施例中,cpu中的統(tǒng)一存儲(chǔ)器訪問解隧道系統(tǒng)接收統(tǒng)一存儲(chǔ)器訪問隧道數(shù)據(jù)包。

6、在一些實(shí)施例中,統(tǒng)一存儲(chǔ)器訪問解隧道系統(tǒng)對(duì)統(tǒng)一存儲(chǔ)器訪問隧道數(shù)據(jù)包進(jìn)行解隧道傳輸(detunnel),以訪問統(tǒng)一存儲(chǔ)器的共享地址空間。

7、在一些實(shí)施例中,高級(jí)互連協(xié)議是高級(jí)可擴(kuò)展接口(advanced?extensibleinterface,axi)協(xié)議或計(jì)算快速鏈路(cxl)協(xié)議。

8、在一些實(shí)施例中,晶粒間互連協(xié)議是通用芯?;ミB快速(universal?chipletinterconnect?express,ucie)協(xié)議。

9、在一些實(shí)施例中,基于高級(jí)互連協(xié)議到晶粒間互連協(xié)議的隧道傳輸,加速器不需要使用加速器存儲(chǔ)器。

10、根據(jù)本公開的第二方面,提供了一種方法,該方法包括:在加速器處生成映射到晶粒間互連的統(tǒng)一存儲(chǔ)器訪問隧道數(shù)據(jù)包協(xié)議結(jié)構(gòu);在加速器處利用統(tǒng)一存儲(chǔ)器訪問隧道數(shù)據(jù)包結(jié)構(gòu)生成統(tǒng)一存儲(chǔ)器訪問隧道數(shù)據(jù)包,統(tǒng)一存儲(chǔ)器訪問隧道數(shù)據(jù)包用于將高級(jí)互連協(xié)議隧道傳輸?shù)脚c晶粒間互連相關(guān)聯(lián)的晶粒間互連協(xié)議;以及利用統(tǒng)一存儲(chǔ)器訪問隧道數(shù)據(jù)包直接訪問統(tǒng)一存儲(chǔ)器。

11、在一些實(shí)施例中,統(tǒng)一存儲(chǔ)器訪問隧道數(shù)據(jù)包包括多個(gè)隧道字段,多個(gè)隧道字段被配置為允許加速器和中央處理單元(cpu)訪問映射到統(tǒng)一存儲(chǔ)器的共享地址空間。

12、在一些實(shí)施例中,該方法還包括:向統(tǒng)一存儲(chǔ)器訪問解隧道系統(tǒng)提供統(tǒng)一存儲(chǔ)器訪問隧道數(shù)據(jù)包。

13、在一些實(shí)施例中,cpu中的統(tǒng)一存儲(chǔ)器訪問解隧道系統(tǒng)接收統(tǒng)一存儲(chǔ)器訪問隧道數(shù)據(jù)包。

14、在一些實(shí)施例中,該方法還包括:利用統(tǒng)一存儲(chǔ)器訪問解隧道系統(tǒng)對(duì)統(tǒng)一存儲(chǔ)器訪問隧道數(shù)據(jù)包進(jìn)行解隧道傳輸,以訪問統(tǒng)一存儲(chǔ)器的共享地址空間。

15、在一些實(shí)施例中,高級(jí)互連協(xié)議是高級(jí)可擴(kuò)展接口(axi)協(xié)議或計(jì)算快速鏈路(cxl)協(xié)議。

16、在一些實(shí)施例中,晶粒間互連是通用芯粒互連快速(ucie)互連。

17、在一些實(shí)施例中,基于高級(jí)互連協(xié)議到晶粒間互連協(xié)議的隧道傳輸,加速器不需要使用本地存儲(chǔ)器。

18、根據(jù)本公開的第三方面,提供了一種服務(wù)器系統(tǒng),該服務(wù)器系統(tǒng)包括:加速器接口控制器;晶粒間互連,該晶粒間互連耦合到加速器接口控制器;以及中央處理單元(cpu)接口控制器,該cpu接口控制器耦合到晶粒間互連,其中,加速器接口控制器被配置為將高級(jí)互連協(xié)議隧道傳輸?shù)脚c晶粒間互連相關(guān)聯(lián)的晶粒間互連協(xié)議,以便訪問統(tǒng)一存儲(chǔ)器。

19、在一些實(shí)施例中,晶粒間互連是通用芯粒互連快速(ucie)互連,并且高級(jí)互連協(xié)議是高級(jí)可擴(kuò)展接口(axi)協(xié)議或計(jì)算快速鏈路(cxl)協(xié)議。

20、在一些實(shí)施例中,cpu接口控制器位于主機(jī)cpu中,并且加速器接口控制器位于視頻加速器中。

21、將認(rèn)識(shí)到的是,本文中描述為適合于結(jié)合到本公開的一個(gè)或多個(gè)方面或?qū)嵤├械娜魏翁卣髦荚诳赏茝V到本公開的任何和所有的方面和實(shí)施例。本領(lǐng)域技術(shù)人員可以根據(jù)本公開的說明書、權(quán)利要求和附圖來理解本公開的其它方面。前述總體性描述和以下詳細(xì)描述僅是示例性和說明性的,而不是對(duì)權(quán)利要求的限制。

22、下面參考附圖詳細(xì)描述了實(shí)施例的進(jìn)一步的特征和優(yōu)點(diǎn)、以及各種實(shí)施例的結(jié)構(gòu)和操作。應(yīng)注意的是,各方法和系統(tǒng)不限于本文所描述的具體實(shí)施例。本文呈現(xiàn)這些實(shí)施例僅出于說明性目的?;诒疚乃慕虒?dǎo),附加的實(shí)施例對(duì)于一個(gè)或多個(gè)相關(guān)領(lǐng)域的技術(shù)人員來說將是顯而易見的。



技術(shù)特征:

1.一種片上系統(tǒng),包括:

2.根據(jù)權(quán)利要求1所述的片上系統(tǒng),其中:

3.根據(jù)權(quán)利要求2所述的片上系統(tǒng),其中:

4.根據(jù)權(quán)利要求2或3所述的片上系統(tǒng),其中:

5.根據(jù)任一項(xiàng)前述權(quán)利要求所述的片上系統(tǒng),其中:

6.根據(jù)任一項(xiàng)前述權(quán)利要求所述的片上系統(tǒng),其中:

7.一種方法,包括:

8.根據(jù)權(quán)利要求7所述的方法,其中:

9.根據(jù)權(quán)利要求7或8所述的方法,還包括:

10.根據(jù)權(quán)利要求7至9中任一項(xiàng)所述的方法,其中:

11.根據(jù)權(quán)利要求7至10中任一項(xiàng)所述的方法,其中:

12.一種服務(wù)器系統(tǒng),包括:

13.根據(jù)權(quán)利要求12所述的服務(wù)器系統(tǒng),其中:

14.根據(jù)權(quán)利要求12或13所述的服務(wù)器系統(tǒng),其中:


技術(shù)總結(jié)
在一些實(shí)施例中,一種片上系統(tǒng)包括:中央處理單元(CPU);加速器,該加速器經(jīng)由第一晶粒間互連耦合到CPU;以及統(tǒng)一存儲(chǔ)器,該統(tǒng)一存儲(chǔ)器經(jīng)由第二晶粒間互連耦合到CPU。在一些實(shí)施例中,為了防止加速器使用加速器存儲(chǔ)器進(jìn)行處理操作,加速器利用位于加速器中的統(tǒng)一存儲(chǔ)器訪問隧道系統(tǒng)來將與第二晶粒間互連相關(guān)聯(lián)的高級(jí)互連協(xié)議隧道傳輸?shù)脚c第一晶粒間互連相關(guān)聯(lián)的晶粒間互連協(xié)議,統(tǒng)一存儲(chǔ)器訪問隧道系統(tǒng)被配置為允許使用共享地址空間來訪問統(tǒng)一存儲(chǔ)器。

技術(shù)研發(fā)人員:哈里克里希納·馬達(dá)迪·雷迪,陳云青,巴希拉坦·阿南德哈倫甘,克里斯蒂安·馬庫(kù)斯·彼得森
受保護(hù)的技術(shù)使用者:元平臺(tái)公司
技術(shù)研發(fā)日:
技術(shù)公布日:2025/6/26
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